Cyclone® IV EP4CE40 FPGA
仕様
インテル®製品の比較
基本仕様
-
製品コレクション
Cyclone® IV E FPGA
-
ステータス
Launched
-
発売日
2009
-
リソグラフィー
60 nm
CNDA アカウントでサインインすると、SKU の詳細が表示されます。
リソース
-
ロジックエレメント (LE)
40000
-
ファブリックおよび I/O 位相ロックループ (PLL)
4
-
最大エンベデッド・メモリー
1.134 Mb
-
デジタル信号処理 (DSP) ブロック
116
-
デジタル信号処理 (DSP) フォーマット
Multiply
-
ハード・メモリー・コントローラー
いいえ
-
外部メモリー・インターフェイス (EMIF)
DDR, DDR2, SDR
I/O 規格
-
最大ユーザーI/O数†
532
-
I/O 標準サポート
3.0 V to 3.3 V LVTTL, 1.2 V to 3.3 V LVCMOS, PCI, PCI-X, SSTL, HSTL, Differential SSTL, Differential HSTL, LVDS, Mini-LVDS, RSDS, LVPECL, BLVDS, PPDS
高度なテクノロジー
パッケージの仕様
-
パッケージオプション
U484, F324, F484, F780
オーダーとコンプライアンス情報
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オーダー & スペック情報
Cyclone® IV EP4CE40 FPGA EP4CE40U19I7
- MM# 974422
- スペックコード SRCGM
- オーダーコード EP4CE40U19I7
- ステッピング A1
- ECCN 3A991
トレード・コンプライアンス情報
- ECCN 製品によって異なる
- CCATS NA
- US HTS 8542390001
製品仕様変更通知 (PCN) 情報
SRAGZ
- 971902 製品仕様変更通知 (PCN)
SRAGY
- 971901 製品仕様変更通知 (PCN)
SRAGX
- 971900 製品仕様変更通知 (PCN)
SRAGW
- 971899 製品仕様変更通知 (PCN)
SRAGV
- 971898 製品仕様変更通知 (PCN)
SRAGU
- 971897 製品仕様変更通知 (PCN)
SRB5B
- 973201 製品仕様変更通知 (PCN)
SR649
- 967310 製品仕様変更通知 (PCN)
SRB59
- 973199 製品仕様変更通知 (PCN)
SRB58
- 973198 製品仕様変更通知 (PCN)
SRB57
- 973197 製品仕様変更通知 (PCN)
SRAMM
- 972524 製品仕様変更通知 (PCN)
SRAML
- 972523 製品仕様変更通知 (PCN)
SR9D9
- 971166 製品仕様変更通知 (PCN)
SRAGT
- 971896 製品仕様変更通知 (PCN)
SRB5A
- 973200 製品仕様変更通知 (PCN)
SR9D8
- 971165 製品仕様変更通知 (PCN)
SR9D7
- 971164 製品仕様変更通知 (PCN)
SRCGL
- 974421 製品仕様変更通知 (PCN)
SR5WQ
- 967041 製品仕様変更通知 (PCN)
SR8HV
- 970219 製品仕様変更通知 (PCN)
SR8HU
- 970218 製品仕様変更通知 (PCN)
SR64B
- 967312 製品仕様変更通知 (PCN)
SR8HT
- 970217 製品仕様変更通知 (PCN)
SR64A
- 967311 製品仕様変更通知 (PCN)
SR8HS
- 970216 製品仕様変更通知 (PCN)
SR8HR
- 970215 製品仕様変更通知 (PCN)
SR5WP
- 967040 製品仕様変更通知 (PCN)
SR5WN
- 967039 製品仕様変更通知 (PCN)
SR5WM
- 967038 製品仕様変更通知 (PCN)
ドライバーおよびソフトウェア
詳細
タイプ
詳細情報
OS
バージョン
日付
すべて
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ダウンロード
結果が見つかりません。検索条件:
Y
/apps/intel/arksuite/template/arkProductPageTemplate
最新ドライバーとソフトウェア
発売日
製品が初めて導入された日。
リソグラフィー
リソグラフィーとは、集積回路の製造に使われる半導体技術のことです。プロセスの微細度を表す単位はナノメートル (nm) です。この値から、半導体に組込まれている機能サイズが分かります。
ロジックエレメント (LE)
ロジックエレメント (LE) は、インテル® FPGA アーキテクチャにおけるロジックの最小単位です。コンパクトな LE は、効率的なロジックの使用と高度な機能を提供します。
ファブリックおよび I/O 位相ロックループ (PLL)
ファブリックおよび IO PLL は インテル® FPGA ファブリックのクロック・ネットワークと デバイスの IO セルに関連するクロック・ネットワークの設計と実装を簡素化するために使用されます
最大エンベデッド・メモリー
インテル® FPGA デバイスのプログラマブル・ファブリックにあるすべてのエンベデッド・メモリー・ブロックの合計容量です
デジタル信号処理 (DSP) ブロック
デジタル信号プロセシング (DSP) ブロックは サポートされるインテル® FPGA デバイスの数学的ビルディング・ブロックで さまざまなデジタル信号プロセシング機能を実装するためのハイパフォーマンス乗算器とアキュムレータを含んでいます
デジタル信号処理 (DSP) フォーマット
インテル® FPGA デバイス・ファミリーによって、DSP ブロックはハード・フローティング・ポイント、ハード固定ポイント、乗算および累積、乗算のみなどの異なる形式をサポートします
ハード・メモリー・コントローラー
ハード・メモリー・コントローラーは インテルFPGAに接続されたハイパフォーマンス外部メモリー・システムを実現するために使用されますハード・メモリー・コントローラーは、同等のソフト・メモリー・コントローラーと比較して 消費電力とFPGAリソースを節約し より高いフリークエンシーでの動作をサポートします
外部メモリー・インターフェイス (EMIF)
インテル® FPGA デバイスがサポートする外部メモリー・インターフェイス・プロトコルです
最大ユーザーI/O数†
インテル® FPGA デバイスの汎用 I/O ピンの最大ナンバー (利用可能な最大パッケージの場合) です
†パッケージにより 実際のカウントはこれより少なくなる場合があります
I/O 標準サポート
インテル® FPGA デバイスがサポートする汎用 I/O インターフェイス規格です
FPGA ビットストリーム・セキュリティー
インテル® FPGA デバイスファミリーによって、顧客のビットストリームのコピーを防止したり、動作中のデバイスへの不正操作を検出したりするさまざまなセキュリティー機能を使用することが可能です。
アナログ・デジタル・コンバーター
アナログ・デジタル・コンバーターは、インテル® FPGA デバイスファミリーで利用できるデータ・コンバーター・リソースです。
パッケージオプション
インテルFPGAデバイスは お客様のシステム要件に合わせて 異なるパッケージサイズ 異なるIOおよびトランシーバー数で提供されています
提供されているすべての情報は予告なしに変更されることがあります。インテル製品は随時、製造ライフサイクル、仕様、および製品の説明が予告なく変更される場合があります。ここに記載された情報は「現状」のまま提供されるものであり、インテルは情報の正確性、または製品の機能、利用可能性、機能性、記載された製品の互換性についていかなる表明も保証もいたしません。特定の製品やシステムの詳細については、各システムベンダーにお問い合わせください。
インテルの分類は一般的、教育的、計画的な目的のためだけであり、輸出管理分類番号 (ECCN) と統一関税品目 (HTS) 番号で構成されています。インテルの分類の取り扱いについては、インテルによらず、適切な ECCN または HTS について表明または保証を行うことを意味するものではありません。輸入業者または輸出業者は、取引の正確な分類を決定する責任を負うものとします。
製品の特性や機能の公式の定義については、データシートを参照してください。
‡ この機能は、コンピューティング・システムによっては利用できないことがあります。ご利用のシステムにこの機能が搭載されているかどうか、あるいは機能の互換性に関してシステム仕様 (マザーボード、プロセッサー、チップセット、電源、HDD、グラフィックス・コントローラー、メモリー、BIOS、ドライバー、仮想マシンモニター - VMM、プラットフォーム・ソフトウェア、およびオペレーティング・システム) を参照するには、システムベンダーにご確認ください。機能、パフォーマンス、この機能のその他の利点は、システム構成により異なります。
「発表済み」 SKUs はまだ使用できません。販売開始については、発売日を参照ください。