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  • ブランド名: Core i7

  • 製品番号: i7-12700KF

  • オーダーコード: CM8071504553829

  • スペックコード: SRL4P

  • 開発コード名: Alder Lake

インテル® Stratix® 10 GX 1660 FPGA

仕様

仕様情報のエクスポート

基本仕様

I/O 規格

パッケージの仕様

オーダーとコンプライアンス情報

オーダー & スペック情報

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN2F43I2VGAS

  • MM# 999K6C
  • スペックコード SRGLA
  • オーダーコード 1SG166HN2F43I2VGAS
  • ステッピング B0
  • MDDS コンテンツ ID 706679

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN1F43I1VGAS

  • MM# 999T4X
  • スペックコード SRH1S
  • オーダーコード 1SG166HN1F43I1VGAS
  • ステッピング B0

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN1F43I2LGAS

  • MM# 999T4Z
  • スペックコード SRH1T
  • オーダーコード 1SG166HN1F43I2LGAS
  • ステッピング B0

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN1F43I2VGAS

  • MM# 999T50
  • スペックコード SRH1U
  • オーダーコード 1SG166HN1F43I2VGAS
  • ステッピング B0

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN2F43I1VGAS

  • MM# 999T51
  • スペックコード SRH1V
  • オーダーコード 1SG166HN2F43I1VGAS
  • ステッピング B0

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN2F43I2LGAS

  • MM# 999T52
  • スペックコード SRH1W
  • オーダーコード 1SG166HN2F43I2LGAS
  • ステッピング B0

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN3F43I3VGAS

  • MM# 999T53
  • スペックコード SRH1X
  • オーダーコード 1SG166HN3F43I3VGAS
  • ステッピング B0

トレード・コンプライアンス情報

  • ECCN 3A001.A.7.B
  • CCATS G171972
  • US HTS 8542390001

製品仕様変更通知 (PCN) 情報

SRH1X

SRH1W

SRH1V

SRGLA

SRH1U

SRH1T

SRH1S

ドライバーおよびソフトウェア

最新ドライバーとソフトウェア

利用可能なダウンロード:
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発売日

製品が初めて導入された日。

リソグラフィー

リソグラフィーとは、集積回路の製造に使われる半導体技術のことです。プロセスの微細度を表す単位はナノメートル (nm) です。この値から、半導体に組込まれている機能サイズが分かります。

ロジックエレメント (LE)

ロジックエレメント (LE) は、インテル® FPGA アーキテクチャにおけるロジックの最小単位です。コンパクトな LE は、効率的なロジックの使用と高度な機能を提供します。

アダプティブ・ロジック・モジュール (ALM)

アダプティブ・ロジック・モジュール（ALM）は サポートされるインテルFPGAデバイスのロジック・ビルディング・ブロックで パフォーマンスと利用率の両方を最大化するように設計されています各ALMは いくつかの異なる動作モードを持ち 様々な異なる組み合わせやシーケンシャルな論理関数を実装することがでます

アダプティブ・ロジック・モジュール (ALM) レジスター

ALMレジスターは ALM内部に含まれるレジスター・ビット（フリップフロップ）で シーケンシャル・ロジックを実現するために使用されます

ファブリックおよび I/O 位相ロックループ (PLL)

ファブリックおよび IO PLL は インテル® FPGA ファブリックのクロック・ネットワークと デバイスの IO セルに関連するクロック・ネットワークの設計と実装を簡素化するために使用されます

最大エンベデッド・メモリー

インテル® FPGA デバイスのプログラマブル・ファブリックにあるすべてのエンベデッド・メモリー・ブロックの合計容量です

デジタル信号処理 (DSP) ブロック

デジタル信号プロセシング (DSP) ブロックは サポートされるインテル® FPGA デバイスの数学的ビルディング・ブロックで さまざまなデジタル信号プロセシング機能を実装するためのハイパフォーマンス乗算器とアキュムレータを含んでいます

デジタル信号処理 (DSP) フォーマット

インテル® FPGA デバイス・ファミリーによって、DSP ブロックはハード・フローティング・ポイント、ハード固定ポイント、乗算および累積、乗算のみなどの異なる形式をサポートします

ハード・メモリー・コントローラー

ハード・メモリー・コントローラーは インテルFPGAに接続されたハイパフォーマンス外部メモリー・システムを実現するために使用されますハード・メモリー・コントローラーは、同等のソフト・メモリー・コントローラーと比較して 消費電力とFPGAリソースを節約し より高いフリークエンシーでの動作をサポートします

外部メモリー・インターフェイス (EMIF)

インテル® FPGA デバイスがサポートする外部メモリー・インターフェイス・プロトコルです

最大ユーザーI/O数†

インテル® FPGA デバイスの汎用 I/O ピンの最大ナンバー (利用可能な最大パッケージの場合) です
†パッケージにより 実際のカウントはこれより少なくなる場合があります

I/O 標準サポート

インテル® FPGA デバイスがサポートする汎用 I/O インターフェイス規格です

最大 LVDS ペア

インテル® FPGA デバイスにコンフィギュレーション可能な LVDS ペアの最大ナンバーで 利用可能な最大パッケージの場合パッケージタイプ別の実際のRXおよびTX LVDSペア数については デバイスのドキュメントを参照してください

最大 ノンリターン・ツー・ゼロ (NRZ) トランシーバー†

インテル® FPGA デバイスに搭載される NRZ トランシーバーの最大ナンバー (利用可能な最大パッケージの場合)
†パッケージにより 実際のカウントはこれより少なくなる場合があります

最大 ノンリターン・ツー・ゼロ (NRZ) データ・レート†

NRZトランシーバーがサポートする最大NRZデータレート
†実際のデータレートは トランシーバーのスピード・グレードによって低くなる可能性があります

トランシーバー・プロトコル・ハード IP

高速シリアル・トランシーバをサポートするために インテルFPGAデバイスで利用可能なハード知的財産トランシーバ・プロトコルのハードIPは 同等のソフトIPと比較して消費電力とFPGAリソースを節約し シリアル・プロトコルの実装を簡素化することができます

ハイパーレジスター

ハイパーレジスターは 一部のインテル® FPGA デバイス・ファミリーのインターコネクトにある追加レジスタ ビット (フリップフロップ) で、インターコネクトのタイミング調整とパイプライン化により FPGA ファブリックのクロック・フリークエンシーの高速化を可能にするものです

FPGA ビットストリーム・セキュリティー

インテル® FPGA デバイスファミリーによって、顧客のビットストリームのコピーを防止したり、動作中のデバイスへの不正操作を検出したりするさまざまなセキュリティー機能を使用することが可能です。

パッケージオプション

インテルFPGAデバイスは お客様のシステム要件に合わせて 異なるパッケージサイズ 異なるIOおよびトランシーバー数で提供されています

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インテルの分類は一般的、教育的、計画的な目的のためだけであり、輸出管理分類番号 (ECCN) と統一関税品目 (HTS) 番号で構成されています。インテルの分類の取り扱いについては、インテルによらず、適切な ECCN または HTS について表明または保証を行うことを意味するものではありません。輸入業者または輸出業者は、取引の正確な分類を決定する責任を負うものとします。

製品の特性や機能の公式の定義については、データシートを参照してください。

‡ この機能は、コンピューティング・システムによっては利用できないことがあります。ご利用のシステムにこの機能が搭載されているかどうか、あるいは機能の互換性に関してシステム仕様 (マザーボード、プロセッサー、チップセット、電源、HDD、グラフィックス・コントローラー、メモリー、BIOS、ドライバー、仮想マシンモニター - VMM、プラットフォーム・ソフトウェア、およびオペレーティング・システム) を参照するには、システムベンダーにご確認ください。機能、パフォーマンス、この機能のその他の利点は、システム構成により異なります。

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