FPGA Cyclone® IV EP4CGX50
Specifiche
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Di base
-
Raccolta di prodotti
FPGA Cyclone® IV GX
-
Stato
Launched
-
Data di lancio
2009
-
Litografia
60 nm
Risorse
Specifiche di I/O
-
Num. massimo di I/O utente†
310
-
Supporto per gli standard I/O
3.0 V to 3.3 V LVTTL, 1.2 V to 3.3 V LVCMOS, PCI, PCI-X, SSTL, HSTL, Differential SSTL, Differential HSTL, LVDS, Mini-LVDS, RSDS, LVPECL, BLVDS, PPDS
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Numero massimo di coppie LVDS
98
-
Num. massimo di ricetrasmettitori Non-Return to Zero (NRZ) †
8
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Velocità massima di trasferimento dati Non-Return to Zero (NRZ)†
3.124 Gbps
-
Hard IP protocollo ricetrasmettitore
PCIe Gen1
Tecnologie avanzate
Specifiche del package
-
Opzioni package
F484, F672
Informazioni supplementari
-
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Driver e software
Descrizione
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Sistema operativo
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Supporto
Data di lancio
La data di introduzione del prodotto sul mercato.
Litografia
La litografia fa riferimento alla tecnologia per i semiconduttori impiegata per la produzione di circuiti integrati, riportata in nanometri (nm), che indica le dimensioni delle funzioni integrate nel semiconduttore.
Elementi logici (LE, Logic Element)
Gli elementi logici sono le unità logiche più piccole nell'architettura Intel® FPGA. Gli elementi logici sono compatti e forniscono funzionalità avanzate con un utilizzo efficiente della logica.
Phase-Locked Loop (PLL) fabric e I/O
I PLL di tipo Fabric e IO sono utilizzati per semplificare la progettazione e l'implementazione delle reti di clock nel tessuto FPGA Intel® e delle reti di clock associate alle cellule IO nel dispositivo.
Memoria massima integrata
La capacità totale di tutti i blocchi di memoria integrati nel tessuto programmabile del dispositivo FPGA Intel®.
Blocchi DSP (Digital Signal Processing)
Il blocco di elaborazione del segnale digitale (DSP) è l'elemento matematico costitutivo nei dispositivi FPGA Intel® supportati e contiene moltiplicatori e accumulatori ad alte prestazioni per l'implementazione di una grande varietà di funzioni di elaborazione del segnale digitale.
Formato DSP (Digital Signal Processing)
A seconda della famiglia di dispositivi FPGA Intel®, il blocco DSP supporta formati differenti (per esempio, virgola mobile rigida, virgola fissa, moltiplicazione-accumulo o solo accumulo).
Hard Memory Controller (HMC)
I controller di memoria rigida vengono utilizzati per abilitare sistemi di memoria di tipo esterno ad alte prestazioni collegati all'FPGA Intel®. Se paragonato al controller di memoria soft equivalente, il controller di memoria rigido riduce la potenza e le risorse FPGA e supporta il funzionamento a frequenze più elevate.
Interfacce di memoria esterne (EMIF)
I protocolli di interfaccia di memoria esterna supportati dal dispositivo FPGA Intel®.
Num. massimo di I/O utente†
Il numero massimo di pin I/O general-purpose nel dispositivo FPGA Intel® (nel più grande pacchetto disponibile).
† Il numero reale potrebbe essere inferiore, a seconda del pacchetto.
Supporto per gli standard I/O
Gli standard di interfaccia I/O general-purpose supportati dal dispositivo FPGA Intel®.
Numero massimo di coppie LVDS
Il numero massimo di coppie LVDS che possono essere configurate nel dispositivo FPGA Intel® (nel più grande pacchetto disponibile). Per il numero di coppie LVDS RX e TX in base al tipo di pacchetto, occorre fare riferimento alla documentazione del dispositivo.
Num. massimo di ricetrasmettitori Non-Return to Zero (NRZ) †
Il numero massimo di ricetrasmettitori NRZ nel dispositivo FPGA Intel® (nel più grande pacchetto disponibile).
† Il numero reale potrebbe essere inferiore, a seconda del pacchetto.
Velocità massima di trasferimento dati Non-Return to Zero (NRZ)†
La frequenza di dati NRZ massima supportata dai ricetrasmettitori NRZ.
† La frequenza di dati reale potrebbe essere inferiore, a seconda del livello di velocità del ricetrasmettitore.
Hard IP protocollo ricetrasmettitore
Proprietà intellettuale (hard IP) disponibile nel dispositivo FPGA Intel® per supportare i ricetrasmettitori seriali ad alta velocità. Rispetto all'IP soft equivalente, l'IP rigido del protocollo di ricetrasmettitore consente di risparmiare potenza e risorse FPGA e semplifica l'implementazione del protocollo seriale.
Sicurezza del bitstream FPGA
In base alla famiglia di dispositivi FPGA Intel®, sono disponibili diverse funzionalità di sicurezza per prevenire la copia del bitstream dei clienti e rilevare i tentativi di manomissione del dispositivo durante il funzionamento.
Convertitore analogico-digitale
Il convertitore analogico-digitale è una risorsa di conversione dei dati disponibile in alcune famiglie di dispositivi FPGA Intel.
Opzioni package
I dispositivi FPGA Intel® presentano diverse dimensioni di pacchetti, con quantità di IO e ricetrasmettitori differenti, per soddisfare i requisiti di sistema dei clienti.
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‡ Questa funzione potrebbe non essere disponibile su tutti i sistemi. Per verificare la compatibilità del sistema in uso, contatta il fornitore del sistema oppure consulta le specifiche del sistema (scheda madre, processore, chipset, alimentatore, HDD, controller grafico, memoria, BIOS, driver, virtual machine monitor, piattaforma software e/o sistema operativo). Funzionalità, prestazioni e altri vantaggi di questa funzione possono variare in base alla configurazione del sistema.
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