Cyclone® IV EP4CGX15 FPGA

Spesifikasi

Ekspor spesifikasi

Hal Penting

Spesifikasi I/O

Spesifikasi Paket

Pemesanan dan Kepatuhan

Informasi pemesanan dan spesifikasi

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14I7

  • MM# 967171
  • Kode SPEC SR606
  • Kode Pemesanan EP4CGX15BF14I7
  • Stepping A1
  • ID Konten MDDS 700604

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14C8

  • MM# 967334
  • Kode SPEC SR64Z
  • Kode Pemesanan EP4CGX15BF14C8
  • Stepping A1
  • ID Konten MDDS 699900

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14C6N

  • MM# 970237
  • Kode SPEC SR8JD
  • Kode Pemesanan EP4CGX15BF14C6N
  • Stepping A1
  • ID Konten MDDS 696796746342

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14C7

  • MM# 971178
  • Kode SPEC SR9DM
  • Kode Pemesanan EP4CGX15BF14C7
  • Stepping A1
  • ID Konten MDDS 701814

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14I7N

  • MM# 971179
  • Kode SPEC SR9DN
  • Kode Pemesanan EP4CGX15BF14I7N
  • Stepping A1
  • ID Konten MDDS 693136744685

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14C6

  • MM# 971927
  • Kode SPEC SRAHQ
  • Kode Pemesanan EP4CGX15BF14C6
  • Stepping A1
  • ID Konten MDDS 695976

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14C7N

  • MM# 971928
  • Kode SPEC SRAHR
  • Kode Pemesanan EP4CGX15BF14C7N
  • Stepping A1
  • ID Konten MDDS 694243744707

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14C8N

  • MM# 971929
  • Kode SPEC SRAHS
  • Kode Pemesanan EP4CGX15BF14C8N
  • Stepping A1
  • ID Konten MDDS 697455745693

Cyclone® IV EP4CGX15 FPGA EP4CGX15BF14A7N

  • MM# 974438
  • Kode SPEC SRCH3
  • Kode Pemesanan EP4CGX15BF14A7N
  • Stepping A1
  • ID Konten MDDS 697807

Informasi kepatuhan dagang

  • ECCN EAR99
  • CCATS NA
  • US HTS 8542390001

Informasi PCN

SR9DN

SR8JD

SR9DM

SR606

SR64Z

SRAHS

SRAHR

SRAHQ

Driver dan Perangkat Lunak

Driver & Perangkat Lunak Terbaru

Unduhan Tersedia:
Semua

Nama

Tanggal Peluncuran

Tanggal pertama kali produk diperkenalkan.

Litografi

Litografi mengacu pada teknologi semikonduktor yang digunakan untuk memproduksi sirkuit terintegrasi, dan dilaporkan dalam nanometer (nm), menunjukkan ukuran fitur yang ditanam pada semikonduktor.

Elemen Logika (LE)

Elemen logika (LE) adalah unit logika terkecil dalam arsitektur Intel® FPGA. LE ringkas dan menghadirkan fitur tingkat lanjut dengan penggunaan logika yang efisien.

Fabric dan I/O Phase-Locked Loop (PLL)

Fabric dan IO PLL digunakan untuk menyederhanakan desain dan implementasi jaringan clock dalam fabric Intel® FPGA, serta jaringan clock yang terasosiasi dengan sel IO dalam perangkat.

Memori Tertanam Maksimal

Total kapasitas dari semua blok memori tertanam dalam fabric yang dapat diprogram dari perangkat Intel® FPGA.

Blok Pemrosesan Sinyal Digital (DSP)

Blok pemrosesan sinyal digital (DSP) adalah blok bangunan matematika dalam perangkat Intel® FPGA yang didukung dan mengandung pengganda serta akumulator performa tinggi untuk menerapkan berbagai fungsi pemrosesan sinyal digital.

Format Pemrosesan Sinyal Digital (DSP)

Tergantung pada rangkaian perangkat Intel® FPGA, blok DSP mendukung format berbeda seperti hard floating point, hard fixed point, menggandakan dan mengakumulasikan, serta hanya mengalikan.

Kontroler Memori Keras

Kontroler memori keras digunakan untuk mendukung sistem memori eksternal performa tinggi yang terhubung ke Intel® FPGA. Kontroler memori keras menghemat daya dan sumber daya FPGA jika dibandingkan dengan kontroler memori lunak yang setara, serta mendukung operasi frekuensi yang lebih tinggi.

Antarmuka Memori Eksternal (EMIF)

Protokol antarmuka memori eksternal didukung oleh perangkat Intel® FPGA.

Jumlah I/O Pengguna Maksimal

Jumlah maksimum pin I/O bertujuan umum dalam perangkat Intel® FPGA, dalam paket terbesar yang tersedia.
† Jumlah sebenarnya dapat lebih rendah tergantung paket.

Dukungan Standar I/O

Standar antarmuka I/O bertujuan umum didukung oleh perangkat Intel® FPGA.

Pasangan LVDS Maksimum

Jumlah maksimum pasangan LVDS yang dapat dikonfigurasi dalam perangkat Intel® FPGA, dalam paket terbesar yang tersedia. Lihat dokumentasi perangkat untuk jumlah pasangan RX dan TX LVDS berdasarkan jenis paket.

Transceiver Non-Return to Zero (NRZ) Maksimum

Jumlah transceiver NRZ maksimum dalam perangkat Intel® FPGA, di paket terbesar yang tersedia.
† Jumlah sebenarnya dapat lebih rendah tergantung paket.

Tingkat Data Non-Return to Zero (NRZ) Maksimum

Tingkat data NRZ maksimum yang didukung oleh transceiver NRZ.
† Tingkat data sebenarnya dapat lebih rendah tergantung kelas kecepatan transceiver.

IP Keras Protokol Transceiver

Kekayaan intelektual keras tersedia di perangkat Intel® FPGA untuk mendukung transceiver serial berkecepatan tinggi. IP keras protokol transceiver menghemat daya dan sumber daya FPGA dibandingkan IP lunak yang setara, serta menyederhanakan implementasi protokol serial.

Keamanan Bitstream FPGA

Tergantung pada rangkaian perangkat Intel FPGA, berbagai fitur keamanan tersedia untuk mencegah penyalinan bitstream pelanggan, dan mendeteksi upaya untuk mengubah perangkat selama operasi.

Konverter Analog ke Digital

Konverter analog ke digital adalah sumber daya konverter data yang tersedia di beberapa rangkaian perangkat Intel FPGA.

Pilihan Paket

Perangkat Intel® FPGA tersedia dalam ukuran paket yang berbeda, dengan jumlah IO dan transceiver yang berbeda, untuk menyesuaikan kebutuhan sistem pelanggan.