FPGA Intel® Agilex™ 7 série F-014
Caractéristiques techniques
Comparer les produits Intel®
Infos essentielles
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Ensemble de produits
FPGA et FPGA SoC Intel® Agilex™ 7 série F
-
état
Launched
-
Date de lancement
Q2'19
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Lithographie
10 nm
Ressources
-
Éléments logiques (EL)
1437240
-
Modules logiques adaptatifs (ALM)
487200
-
Registres du module logique adaptatif (ALM)
1948800
-
Boucles de structure et d'E/S à phase asservie (PLL)
24
-
Mémoire embarquée maximale
190 Mb
-
Blocs DSP (Digital Signal Processing)
4510
-
Format DSP (Digital Signal Processing)
Fixed Point (hard IP), Floating Point (hard IP), Multiply, Multiply and Accumulate, Variable Precision
-
Système processeur matériel (HPS)
Quad-core 64 bit Arm* Cortex*-A53
-
Blocs cryptographiques durs
0
-
Contrôleurs de mémoire matériels
Oui
-
Interfaces de mémoire externes (EMIF)
DDR4, QDR IV
Configuration E/S
-
Nombre maximal d'E/S utilisateur†
768
-
Prise en charge des normes d'E/S
1.2 V LVCMOS, 1.8 V LVCMOS, SSTL, POD, HSTL, HSUL, Differential SSTL, Differential POD, Differential HSTL, Differential HSUL, True Differential Signaling
-
Nbre maximal de paires LVDS
384
-
Nombre maximal d'émetteurs-récepteurs sans retour à zéro (NRZ, Non-Return to Zero)†
16
-
Débit de données maximal sans retour à zéro (NRZ)†
28.9 Gbps
-
Nombre maximal d'émetteurs-récepteurs à modulation d'impulsions en amplitude (PAM4, Pulse-Amplitude Modulation)†
8
-
Débit de données maximal à modulation d'impulsions en amplitude (PAM4)†
57.8 Gbps
-
IP matérielle de protocole d'émetteur-récepteur
PCIe Gen4, 10/25/100G Ethernet
Technologies avancées
Spécifications du package
-
Options de packages
R2486A
Infos supplémentaires
-
URL d'infos complémentaires
Product Table (Family Comparison)
Datasheet
All FPGA Documentation
Commande et conformité
Commande et spécifications
Intel® Agilex™ 7 FPGA F-Series 014 (R24B) AGFA014R24B2E4X
- MM# 99AH3F
- Code de spécification SRKVP
- Code de commande AGFA014R24B2E4X
- Progression B2
- ECCN 3A001.A.7.A
- CCATS G171972
Intel® Agilex™ 7 FPGA F-Series 014 (R24B) AGFA014R24B3E4X
- MM# 99AH3K
- Code de spécification SRKVT
- Code de commande AGFA014R24B3E4X
- Progression B2
- ECCN 3A001.A.7.A
- CCATS G171972
Intel® Agilex™ 7 FPGA F-Series 014 (R24B) AGFA014R24B2E4F
- MM# 99AKLK
- Code de spécification SRL09
- Code de commande AGFA014R24B2E4F
- Progression B2
- ECCN 3A001.A.7.A
- CCATS G171972
Intel® Agilex™ 7 FPGA F-Series 014 (R24B) AGFA014R24B2I3E
- MM# 99AKLP
- Code de spécification SRL0D
- Code de commande AGFA014R24B2I3E
- Progression B2
- ECCN 3A001.A.7.A
- CCATS G171972
Informations de conformité commerciale
- ECCN Varie en fonction du produit
- CCATS Varie en fonction du produit
- US HTS 8542390001
Informations PCN
SRKV5
- 99AH11 PCN
SRKV7
- 99AH24 PCN
SRKV9
- 99AH27 PCN
SRL0C
- 99AKLN PCN
SRL0D
- 99AKLP PCN
SRL0E
- 99AKLR PCN
SRL0F
- 99AKLX PCN
SRKWC
- 99AH5G PCN
SRKWD
- 99AH5J PCN
SRL0B
- 99AKLM PCN
SRKWA
- 99AH5A PCN
SRL09
- 99AKLK PCN
SRKWB
- 99AH5F PCN
SRKVR
- 99AH3H PCN
SRKVS
- 99AH3J PCN
SRKVT
- 99AH3K PCN
SRKVU
- 99AH3L PCN
SRKW7
- 99AH50 PCN
SRKW8
- 99AH51 PCN
SRKW9
- 99AH52 PCN
SRKVK
- 99AH38 PCN
SRKVL
- 99AH3A PCN
SRKVM
- 99AH3C PCN
SRKVN
- 99AH3D PCN
SRKVP
- 99AH3F PCN
SRKVQ
- 99AH3G PCN
Pilotes et logiciels
Descriptif
Type
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Système d'exploitation
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Pilotes et logiciels les plus récents
Date de lancement
Date à laquelle le produit a été commercialisé pour la première fois.
Lithographie
La lithographie fait référence à la technologie de gravure utilisée pour fabriquer un circuit intégré et exprimée en nanomètres (nm). Elle indique la taille des fonctions intégrées sur le semi-conducteur.
Éléments logiques (EL)
Les éléments logiques (EL) sont les plus petites unités de logique de l'architecture Intel® FPGA. Les EL sont compacts et fournissent des fonctionnalités avancées avec une utilisation efficace de la logique.
Modules logiques adaptatifs (ALM)
Le module logique adaptatif (ALM, Adaptive Logic Module) est le composant de base logique des appareils Intel® FPGA pris en charge. Il est conçu pour optimiser les performances et l'utilisation. Chaque ALM a plusieurs modes de fonctionnement différents, et peut mettre en œuvre une variété de fonctions logiques combinatoires et séquentielles différentes.
Registres du module logique adaptatif (ALM)
Les registres ALM sont les bits de registre (bascules) qui sont contenus dans les ALM et sont utilisés pour mettre en œuvre une logique séquentielle.
Boucles de structure et d'E/S à phase asservie (PLL)
Les PLL de tissu et d'E/S sont utilisées pour simplifier la conception et la mise en œuvre des réseaux d'horloge dans l'infrastructure Intel® FPGA, ainsi que les réseaux d'horloge associés aux cellules d'E/S dans l'appareil.
Mémoire embarquée maximale
La capacité totale de tous les blocs de mémoire intégrés dans l'infrastructure programmable de l'appareil Intel® FPGA.
Blocs DSP (Digital Signal Processing)
Le bloc de traitement du signal numérique (DSP, Digital Signal Processing) est le composant de base mathématique des appareils Intel® FPGA pris en charge. Il contient des multiplicateurs et des accumulateurs hautes performances permettant de mettre en œuvre diverses fonctions de traitement du signal numérique.
Format DSP (Digital Signal Processing)
Selon la famille d'appareils Intel® FPGA, le bloc DSP prend en charge différents formats tels que la virgule flottante dure, la virgule fixe dure, la multiplication et l'accumulation, et la multiplication uniquement.
Système processeur matériel (HPS)
Le système de processeur matériel (HPS, Hard Processor System) est un système complet de processeur matériel contenu dans l'infrastructure Intel® FPGA.
Contrôleurs de mémoire matériels
Les contrôleurs de mémoire matériels sont utilisés pour permettre la mise en place de systèmes de mémoire externe hautes performances attachés à Intel® FPGA. Un contrôleur de mémoire matériel permet d'économiser de l'énergie et des ressources FPGA par rapport à un contrôleur de mémoire souple équivalent, et prend en charge un fonctionnement à plus haute fréquence.
Interfaces de mémoire externes (EMIF)
Les protocoles d'interface de mémoire externe pris en charge par l'appareil Intel® FPGA.
Nombre maximal d'E/S utilisateur†
Le nombre maximum de broches d'E/S à usage général dans l'appareil Intel® FPGA, dans le plus grand conditionnement disponible.
† Le nombre réel peut être inférieur en fonction du conditionnement.
Prise en charge des normes d'E/S
Les normes d'interface d'E/S à usage général prises en charge par l'appareil Intel® FPGA.
Nbre maximal de paires LVDS
Le nombre maximum de paires LVDS qui peuvent être configurées dans l'appareil Intel® FPGA, dans le plus grand conditionnement disponible. Reportez-vous à la documentation de l'appareil pour connaître le nombre réel de paires LVDS RX et TX par type de conditionnement.
Nombre maximal d'émetteurs-récepteurs sans retour à zéro (NRZ, Non-Return to Zero)†
Le nombre maximum d'émetteurs-récepteurs NRZ dans l'appareil Intel® FPGA, dans le plus grand conditionnement disponible.
† Le nombre réel peut être inférieur en fonction du conditionnement.
Débit de données maximal sans retour à zéro (NRZ)†
Le débit maximal de données NRZ qui est pris en charge par les émetteurs-récepteurs NRZ.
† Le débit de données réel peut être inférieur en fonction de la vitesse de l'émetteur-récepteur.
Nombre maximal d'émetteurs-récepteurs à modulation d'impulsions en amplitude (PAM4, Pulse-Amplitude Modulation)†
Le nombre maximum d'émetteurs-récepteurs PAM4 dans l'appareil Intel® FPGA, dans le plus grand conditionnement disponible.
† Le nombre réel peut être inférieur en fonction du conditionnement.
Débit de données maximal à modulation d'impulsions en amplitude (PAM4)†
Le débit maximum de données PAM4 qui est pris en charge par les émetteurs-récepteurs PAM4.
† Le débit de données réel peut être inférieur en fonction de la vitesse de l'émetteur-récepteur.
IP matérielle de protocole d'émetteur-récepteur
Propriété intellectuelle matérielle disponible dans l'appareil Intel® FPGA pour prendre en charge les émetteurs-récepteurs série à haute vitesse. La propriété intellectuelle matérielle du protocole de l'émetteur-récepteur permet d'économiser de l'énergie et des ressources FPGA par rapport à la propriété intellectuelle logicielle équivalente, et simplifie la mise en œuvre du protocole série.
Hyper-registres
Les hyper-registres sont des bits de registre supplémentaires (bascules) situés dans l'interconnexion de certaines familles d'appareils Intel® FPGA, ce qui permet de re-synchroniser et de pipeliner l'interconnexion pour permettre une fréquence d'horloge plus élevée dans l'infrastructure FPGA.
Sécurité du flux binaire des FPGA
En fonction de la famille de périphériques Intel® FPGA, plusieurs fonctions de sécurité permettant d'empêcher la copie du flux binaire du client et de détecter les tentatives de piratage de l'appareil pendant son fonctionnement sont disponibles.
Options de packages
Les appareils Intel® FPGA sont disponibles dans différentes tailles de conditionnement, avec différents nombres d'E/S et d'émetteurs-récepteurs, pour répondre aux besoins des systèmes des clients.
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Les classifications Intel sont uniquement destinées à des fins générales, éducatives et de planification, et consistent en des numéros ECCN (Export Control Classification Numbers) et des numéros HTS (Harmonized Tariff Schedule). Les classifications Intel sont utilisées sans avoir recours à Intel et ne doivent pas être interprétées comme une déclaration ou garantie quant aux numéros ECCN ou HTS corrects. En tant qu'importateur et/ou exportateur, il convient à votre entreprise de déterminer la classification correcte de la transaction.
Reportez-vous à la fiche technique pour connaître les propriétés et les caractéristiques officielles du produit.
‡ Cette fonction peut ne pas être disponible sur tous les systèmes informatiques. Renseignez-vous auprès du fabricant de l'ordinateur pour savoir si votre système propose cette fonction ou indiquez les caractéristiques techniques (carte mère, processeur, chipset, bloc d'alimentation, disque dur, contrôleur graphique, mémoire, BIOS, pilotes, moniteur de machine virtuelle (VMM), logiciel de plateforme et/ou système d'exploitation) pour obtenir des informations sur la compatibilité des fonctions. Les fonctionnalités, performances et autres avantages de cette fonction peuvent varier en fonction de la configuration système.
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