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  • Marque : Core i7

  • Référence du produit : i7-12700KF

  • Code de commande : CM8071504553829

  • Code de spécification : SRL4P

  • Nom de code : Alder Lake

FPGA Intel® Stratix® 10 GX 1660

Caractéristiques techniques

Spécifications d'envoi

Infos essentielles

Ressources

Configuration E/S

Technologies avancées

Spécifications du package

Infos supplémentaires

Commande et conformité

Commande et spécifications

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN2F43I2VGAS

  • MM# 999K6C
  • Code de spécification SRGLA
  • Code de commande 1SG166HN2F43I2VGAS
  • Progression B0
  • MDDS - Content ID 706679

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN1F43I1VGAS

  • MM# 999T4X
  • Code de spécification SRH1S
  • Code de commande 1SG166HN1F43I1VGAS
  • Progression B0

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN1F43I2LGAS

  • MM# 999T4Z
  • Code de spécification SRH1T
  • Code de commande 1SG166HN1F43I2LGAS
  • Progression B0

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN1F43I2VGAS

  • MM# 999T50
  • Code de spécification SRH1U
  • Code de commande 1SG166HN1F43I2VGAS
  • Progression B0

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN2F43I1VGAS

  • MM# 999T51
  • Code de spécification SRH1V
  • Code de commande 1SG166HN2F43I1VGAS
  • Progression B0

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN2F43I2LGAS

  • MM# 999T52
  • Code de spécification SRH1W
  • Code de commande 1SG166HN2F43I2LGAS
  • Progression B0

Intel® Stratix® 10 GX 1660 FPGA 1SG166HN3F43I3VGAS

  • MM# 999T53
  • Code de spécification SRH1X
  • Code de commande 1SG166HN3F43I3VGAS
  • Progression B0

Informations de conformité commerciale

  • ECCN 3A001.A.7.B
  • CCATS G171972
  • US HTS 8542390001

Informations PCN

SRH1X

SRH1W

SRH1V

SRGLA

SRH1U

SRH1T

SRH1S

Pilotes et logiciels

Pilotes et logiciels les plus récents

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Nom

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Date de lancement

Date à laquelle le produit a été commercialisé pour la première fois.

Lithographie

La lithographie fait référence à la technologie de gravure utilisée pour fabriquer un circuit intégré et exprimée en nanomètres (nm). Elle indique la taille des fonctions intégrées sur le semi-conducteur.

Éléments logiques (EL)

Les éléments logiques (EL) sont les plus petites unités de logique de l'architecture Intel® FPGA. Les EL sont compacts et fournissent des fonctionnalités avancées avec une utilisation efficace de la logique.

Modules logiques adaptatifs (ALM)

Le module logique adaptatif (ALM, Adaptive Logic Module) est le composant de base logique des appareils Intel® FPGA pris en charge. Il est conçu pour optimiser les performances et l'utilisation. Chaque ALM a plusieurs modes de fonctionnement différents, et peut mettre en œuvre une variété de fonctions logiques combinatoires et séquentielles différentes.

Registres du module logique adaptatif (ALM)

Les registres ALM sont les bits de registre (bascules) qui sont contenus dans les ALM et sont utilisés pour mettre en œuvre une logique séquentielle.

Boucles de structure et d'E/S à phase asservie (PLL)

Les PLL de tissu et d'E/S sont utilisées pour simplifier la conception et la mise en œuvre des réseaux d'horloge dans l'infrastructure Intel® FPGA, ainsi que les réseaux d'horloge associés aux cellules d'E/S dans l'appareil.

Mémoire embarquée maximale

La capacité totale de tous les blocs de mémoire intégrés dans l'infrastructure programmable de l'appareil Intel® FPGA.

Blocs DSP (Digital Signal Processing)

Le bloc de traitement du signal numérique (DSP, Digital Signal Processing) est le composant de base mathématique des appareils Intel® FPGA pris en charge. Il contient des multiplicateurs et des accumulateurs hautes performances permettant de mettre en œuvre diverses fonctions de traitement du signal numérique.

Format DSP (Digital Signal Processing)

Selon la famille d'appareils Intel® FPGA, le bloc DSP prend en charge différents formats tels que la virgule flottante dure, la virgule fixe dure, la multiplication et l'accumulation, et la multiplication uniquement.

Contrôleurs de mémoire matériels

Les contrôleurs de mémoire matériels sont utilisés pour permettre la mise en place de systèmes de mémoire externe hautes performances attachés à Intel® FPGA. Un contrôleur de mémoire matériel permet d'économiser de l'énergie et des ressources FPGA par rapport à un contrôleur de mémoire souple équivalent, et prend en charge un fonctionnement à plus haute fréquence.

Interfaces de mémoire externes (EMIF)

Les protocoles d'interface de mémoire externe pris en charge par l'appareil Intel® FPGA.

Nombre maximal d'E/S utilisateur†

Le nombre maximum de broches d'E/S à usage général dans l'appareil Intel® FPGA, dans le plus grand conditionnement disponible.
† Le nombre réel peut être inférieur en fonction du conditionnement.

Prise en charge des normes d'E/S

Les normes d'interface d'E/S à usage général prises en charge par l'appareil Intel® FPGA.

Nbre maximal de paires LVDS

Le nombre maximum de paires LVDS qui peuvent être configurées dans l'appareil Intel® FPGA, dans le plus grand conditionnement disponible. Reportez-vous à la documentation de l'appareil pour connaître le nombre réel de paires LVDS RX et TX par type de conditionnement.

Nombre maximal d'émetteurs-récepteurs sans retour à zéro (NRZ, Non-Return to Zero)†

Le nombre maximum d'émetteurs-récepteurs NRZ dans l'appareil Intel® FPGA, dans le plus grand conditionnement disponible.
† Le nombre réel peut être inférieur en fonction du conditionnement.

Débit de données maximal sans retour à zéro (NRZ)†

Le débit maximal de données NRZ qui est pris en charge par les émetteurs-récepteurs NRZ.
† Le débit de données réel peut être inférieur en fonction de la vitesse de l'émetteur-récepteur.

IP matérielle de protocole d'émetteur-récepteur

Propriété intellectuelle matérielle disponible dans l'appareil Intel® FPGA pour prendre en charge les émetteurs-récepteurs série à haute vitesse. La propriété intellectuelle matérielle du protocole de l'émetteur-récepteur permet d'économiser de l'énergie et des ressources FPGA par rapport à la propriété intellectuelle logicielle équivalente, et simplifie la mise en œuvre du protocole série.

Hyper-registres

Les hyper-registres sont des bits de registre supplémentaires (bascules) situés dans l'interconnexion de certaines familles d'appareils Intel® FPGA, ce qui permet de re-synchroniser et de pipeliner l'interconnexion pour permettre une fréquence d'horloge plus élevée dans l'infrastructure FPGA.

Sécurité du flux binaire des FPGA

En fonction de la famille de périphériques Intel® FPGA, plusieurs fonctions de sécurité permettant d'empêcher la copie du flux binaire du client et de détecter les tentatives de piratage de l'appareil pendant son fonctionnement sont disponibles.

Options de packages

Les appareils Intel® FPGA sont disponibles dans différentes tailles de conditionnement, avec différents nombres d'E/S et d'émetteurs-récepteurs, pour répondre aux besoins des systèmes des clients.

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Les classifications Intel sont uniquement destinées à des fins générales, éducatives et de planification, et consistent en des numéros ECCN (Export Control Classification Numbers) et des numéros HTS (Harmonized Tariff Schedule). Les classifications Intel sont utilisées sans avoir recours à Intel et ne doivent pas être interprétées comme une déclaration ou garantie quant aux numéros ECCN ou HTS corrects. En tant qu'importateur et/ou exportateur, il convient à votre entreprise de déterminer la classification correcte de la transaction.

Reportez-vous à la fiche technique pour connaître les propriétés et les caractéristiques officielles du produit.

‡ Cette fonction peut ne pas être disponible sur tous les systèmes informatiques. Renseignez-vous auprès du fabricant de l'ordinateur pour savoir si votre système propose cette fonction ou indiquez les caractéristiques techniques (carte mère, processeur, chipset, bloc d'alimentation, disque dur, contrôleur graphique, mémoire, BIOS, pilotes, moniteur de machine virtuelle (VMM), logiciel de plateforme et/ou système d'exploitation) pour obtenir des informations sur la compatibilité des fonctions. Les fonctionnalités, performances et autres avantages de cette fonction peuvent varier en fonction de la configuration système.

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