Intel® Stratix® 10 NX 2100 FPGA

Spezifikationen

Ressourcen

I/O-Spezifikationen

Innovative technische Funktionen

Package-Spezifikationen

Zusätzliche Informationen

Aufgabe von Bestellungen und Einhaltung von Vorschriften

Informationen zu Bestellungen und Spezifikationen

Intel® Stratix® 10 NX 2100 FPGA 1SN21BHU1F53E1VG

  • MM# 999ZRT
  • Spec-Code SRJ8K
  • Bestellbezeichnung 1SN21BHU1F53E1VG
  • Stepping A0
  • Materialdeklarationsdatenblatt Inhaltstypen (MDDS Content IDs) 800035

Intel® Stratix® 10 NX 2100 FPGA 1SN21BHU1F53E2VG

  • MM# 999ZT6
  • Spec-Code SRJ8L
  • Bestellbezeichnung 1SN21BHU1F53E2VG
  • Stepping A0
  • Materialdeklarationsdatenblatt Inhaltstypen (MDDS Content IDs) 800035

Intel® Stratix® 10 NX 2100 FPGA 1SN21BHU2F53E1VG

  • MM# 999ZTK
  • Spec-Code SRJ8M
  • Bestellbezeichnung 1SN21BHU2F53E1VG
  • Stepping A0
  • Materialdeklarationsdatenblatt Inhaltstypen (MDDS Content IDs) 800035

Intel® Stratix® 10 NX 2100 FPGA 1SN21BHU2F53E2VG

  • MM# 999ZV1
  • Spec-Code SRJ8N
  • Bestellbezeichnung 1SN21BHU2F53E2VG
  • Stepping A0
  • Materialdeklarationsdatenblatt Inhaltstypen (MDDS Content IDs) 800035

Intel® Stratix® 10 NX 2100 FPGA 1SN21BHU3F53E2VG

  • MM# 999ZVH
  • Spec-Code SRJ8P
  • Bestellbezeichnung 1SN21BHU3F53E2VG
  • Stepping A0
  • Materialdeklarationsdatenblatt Inhaltstypen (MDDS Content IDs) 800035

Intel® Stratix® 10 NX 2100 FPGA 1SN21BHU3F53E3VG

  • MM# 999ZVJ
  • Spec-Code SRJ8Q
  • Bestellbezeichnung 1SN21BHU3F53E3VG
  • Stepping A0
  • Materialdeklarationsdatenblatt Inhaltstypen (MDDS Content IDs) 800035

Intel® Stratix® 10 NX 2100 FPGA 1SN21CEU2F55E2VG

  • MM# 999ZW0
  • Spec-Code SRJ8U
  • Bestellbezeichnung 1SN21CEU2F55E2VG
  • Stepping A0
  • Materialdeklarationsdatenblatt Inhaltstypen (MDDS Content IDs) 800035809465

Eingestellt und aus dem Angebot genommen

Intel® Stratix® 10 NX 2100 FPGA 1SN21CEU1F55E1VG

  • MM# 999ZVK
  • Spec-Code SRJ8R
  • Bestellbezeichnung 1SN21CEU1F55E1VG
  • Stepping A0
  • Materialdeklarationsdatenblatt Inhaltstypen (MDDS Content IDs) 800035

Intel® Stratix® 10 NX 2100 FPGA 1SN21CEU1F55E2VG

  • MM# 999ZVT
  • Spec-Code SRJ8S
  • Bestellbezeichnung 1SN21CEU1F55E2VG
  • Stepping A0
  • Materialdeklarationsdatenblatt Inhaltstypen (MDDS Content IDs) 800035

Intel® Stratix® 10 NX 2100 FPGA 1SN21CEU2F55E1VG

  • MM# 999ZVW
  • Spec-Code SRJ8T
  • Bestellbezeichnung 1SN21CEU2F55E1VG
  • Stepping A0
  • Materialdeklarationsdatenblatt Inhaltstypen (MDDS Content IDs) 800035

Intel® Stratix® 10 NX 2100 FPGA 1SN21CEU3F55E2VG

  • MM# 999ZWA
  • Spec-Code SRJ8V
  • Bestellbezeichnung 1SN21CEU3F55E2VG
  • Stepping A0
  • Materialdeklarationsdatenblatt Inhaltstypen (MDDS Content IDs) 800035

Intel® Stratix® 10 NX 2100 FPGA 1SN21CEU3F55E3VG

  • MM# 999ZWC
  • Spec-Code SRJ8W
  • Bestellbezeichnung 1SN21CEU3F55E3VG
  • Stepping A0
  • Materialdeklarationsdatenblatt Inhaltstypen (MDDS Content IDs) 800035

Informationen zur Einhaltung von Handelsvorschriften

  • ECCN 3A001.A.7.B
  • CCATS G171972
  • US HTS 8542390001

PCN Informationen

SRJ8U

SRJ8V

SRJ8W

SRJ8K

SRJ8L

SRJ8M

SRJ8N

SRJ8P

SRJ8Q

SRJ8R

SRJ8S

SRJ8T

Treiber und Software

Neueste Treiber und Software

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Name

Einführungsdatum

Das Datum, an dem das Produkt erstmals auf dem Markt eingeführt wurde.

Lithographie

„Lithographie“ bezieht sich auf die Halbleitertechnik, die für die Herstellung einer integrierten Leiterplatine verwendet und in Nanometern (nm) angegeben wird. Dadurch wird der Funktionsumfang des Halbleiters angezeigt.

Logikelemente (LE)

Logikelemente (LEs) sind die kleinsten Logikeinheiten in der Intel® FPGA-Architektur. LEs sind kompakt und bieten erweiterte Funktionen mit effizienter Logiknutzung.

Adaptive Logik-Module (ALM)

Das Adaptive Logic Module (ALM) ist der Logikbaustein in unterstützten Intel FPGA-Geräten und wurde entwickelt, um sowohl die Leistung als auch die Auslastung zu maximieren. Jedes ALM hat mehrere verschiedene Arbeitsweisen und kann eine Vielzahl verschiedener kombinatorischer und sequentieller logischer Funktionen implementieren.

ALM-Register (Adaptive Logic Module)

ALM-Register sind die Registerbits (Flip-Flops), die in den ALMs enthalten sind und zur Implementierung sequentieller Logik verwendet werden.

Fabric- und I/O-Phasenregelkreise (PLLs)

Fabric- und IO-PLLs werden zur Vereinfachung des Designs und der Implementierung der Taktnetzwerke in der Intel FPGA Fabric sowie der mit den IO-Zellen im Gerät verbundenen Taktnetzwerke verwendet.

Maximaler integrierter Speicher

Die Gesamtkapazität aller eingebetteten Speicherblöcke in der programmierbaren Struktur des Intel FPGA-Geräts.

Max. Arbeitsspeicher mit hoher Bandbreite

Die Gesamtkapazität aller In-Package-Speicherstacks mit hoher Bandbreite im Intel FPGA Gerät.
† Die tatsächliche Anzahl kann je nach Paket niedriger sein.

Blöcke für die digitale Signalverarbeitung (DSP)

Der digitale Signalverarbeitungsblock (DSP) ist der mathematische Baustein in unterstützten Intel FPGA-Geräten und enthält leistungsstarke Multiplikatoren und Akkumulatoren zur Implementierung einer Vielzahl von digitalen Signalverarbeitungsfunktionen.

Format für die digitale Signalverarbeitung (DSP)

Je nach Gerätereihe des Intel FPGA unterstützt der DSP-Block verschiedene Formate wie hartes Gleitkomma, hartes Festkomma, Multiplikation und Akkumulation oder nur Multiplikation.

Festspeichercontroller

Festspeichercontroller werden verwendet, um leistungsstarke externe Speichersysteme zu ermöglichen, die an das Intel FPGA angeschlossen sind. Ein Festspeichercontroller spart im Vergleich zu einem entsprechenden Soft-Memory-Controller Strom und FPGA-Ressourcen und unterstützt einen Betrieb mit höherer Frequenz.

External Memory Interfaces (EMIF)

Die vom Intel FPGA Gerät unterstützten externen Speicherschnittstellenprotokolle.

Maximaler Benutzer I/O-Wert

Die maximale Anzahl von Allzweck-E/A-Pins im Intel FPGA Gerät, im größten verfügbaren Paket.
† Die tatsächliche Anzahl kann je nach Paket niedriger sein.

I/O-Standards-Unterstützung

Die vom Intel FPGA Gerät unterstützten Standards für die Allzweck-E/A-Schnittstelle.

Maximale LVDS-Paare

Die maximale Anzahl von LVDS die im Intel FPGA Gerät konfiguriert werden können, im größten verfügbaren Paket. Die tatsächliche Anzahl der RX- und TX-LVDS-Paare je nach Paket-Typ finden Sie in der Gerätedokumentation.

Maximale Non-Return to Zero (NRZ) Transceiver

Die maximale Anzahl von NRZ im Intel FPGA Gerät im größten verfügbaren Paket.
† Die tatsächliche Anzahl kann je nach Paket niedriger sein.

Maximale Non-Return to Zero (NRZ) Datenrate

Die maximale NRZ Datenrate, die von den NRZ Transceivern unterstützt wird.
† Die tatsächliche Datenrate kann je nach Transceiver-Geschwindigkeitsklasse niedriger sein.

Maximale Pulse-Amplitude Modulation (PAM4) Transceiver

Die maximale Anzahl von PAM4 Transceivern im Intel FPGA Gerät im größten verfügbaren Paket.
† Die tatsächliche Anzahl kann je nach Paket niedriger sein.

Maximale Pulse-Amplitude Modulation (PAM4) Datenrate

Die maximale PAM4-Datenrate, die von den PAM4-Transceivern unterstützt wird.
† Die tatsächliche Datenrate kann je nach Transceiver-Geschwindigkeitsklasse niedriger sein.

Transceiver Protocol Hard IP

Hartes geistiges Eigentum, das im Intel FPGA Gerät zur Unterstützung der seriellen Hochgeschwindigkeitstransceiver verfügbar ist. Die Transceiver Protokoll Hard IP spart im Vergleich zur entsprechenden Soft-IP Strom und FPGA-Ressourcen und vereinfacht die Implementierung des seriellen Protokolls.

Hyper-Register

Hyper-Register sind zusätzliche Registerbits (Flip-Flops) im Interconnect einiger Intel FPGA-Gerätereihen, die ein Re-Timing und Pipelining des Interconnects ermöglichen, um eine höhere Taktfrequenz in der FPGA Fabric zu erreichen.

FPGA-Bitstrom-Sicherheit

Je nach Intel FPGA-Gerätereihe stehen verschiedene Sicherheitsfunktionen zur Verfügung, um das Kopieren des Bitstorms des Kunden zu verhindern und Manipulationsversuche am Gerät während des Betriebs zu erkennen.

Paketoptionen

Intel FPGA Geräte sind in verschiedenen Paketgrößen mit unterschiedlichen E/A- und Transceiver-Zahlen erhältlich, um den Systemanforderungen der Kunden gerecht zu werden.